用户: Qianzi时间: 2020-12-17 14:38:52 来自: 在线版
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解：根据主从JK触发器的特点，在CLK＝1期间，若Q＝0且出现J＝1，那么脉冲下降沿来临时，从触发器被置1。否则，可以直接按照脉冲下降沿到达时JK的状态确定输出的状态。
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阎石《数字电子技术基础》（第6版）笔记和课后习题（含考研真题）详解
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第1章 数制和码制
1.1 复习笔记
1.2 课后习题详解
1.3 名校考研真题详解
第2章 逻辑代数基础
2.1 复习笔记
2.2 课后习题详解
2.3 名校考研真题详解
第3章 门电路
3.1 复习笔记
3.2 课后习题详解
3.3 名校考研真题详解
第4章 组合逻辑电路
4.1 复习笔记
4.2 课后习题详解
4.3 名校考研真题详解
第5章 半导体存储电路
5.1 复习笔记
5.2 课后习题详解
5.3 名校考研真题详解
第6章 时序逻辑电路
6.1 复习笔记
6.2 课后习题详解
6.3 名校考研真题详解
第7章 脉冲波形的产生和整形
7.1 复习笔记
7.2 课后习题详解
7.3 名校考研真题详解
第8章 数-模和模-数转换
8.1 复习笔记
8.2 课后习题详解
8.3 名校考研真题详解
